【新子安！】半導体メモリ向けのRTL検証(SystemVerilog/SVA)

ポイント

勤務地	神奈川県横浜市神奈川区ＪＲ京浜東北線新子安駅徒歩 9分京急本線京急新子安駅徒歩 10分
期間	2026年07月上旬～長期契約更新のある長期のお仕事です
就業時間	8:30～17:15 休憩60分【実働】 7時間45分【残業】 5～19時間/月【曜日】月～金週5日
給与	時給 3,050円～3,050円月収例 472,750円+残業代通勤交通費全額支給時給・日給の場合の月収例は、勤務日数・時間によって計算しています。・週5の仕事：月20日（週5×4週）・週4の仕事：月16日（週4×4週） close
職種	設計(電気系) / 試作・実験・評価(電気系)
内容	半導体メモリ向けのRTL検証 ◎半導体メモリ向けLSIの単体ブロックを対象としたRTLロジック検証業務 ◆仕様書や検証項目を確認しながら、検証作業実施 ◆検証コードの作成、修正対応 ◆検証環境へのチェック機能の追加や、機能カバレッジ（FCOV）の実装 ◆シミュレーション結果の波形確認や不具合の切り分け対応【環境】SystemVerilog、SVA
募集人数	1名

実務経験	【必須】 ■RTL設計の検証業務経験（シミュレーション波形を見ながら確認できる方） ■SystemVerilog及びSVAを用いた検証コードの作成、修正経験

オフィス環境

多い年齢層

業種	ソフトウェア開発 / その他製造
事業内容	【大手電機メーカーグループ】IT・エンジニアリング系企業

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